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Clock=-17. MUXx select one SW data from five PATH registers. MODE B. PATH0. PATH1. PATH2. PATH3. PATH4. MUX. 16PE. PEx do the calculation ∑|a-b|, b is the data selected by MUXx in the last clock , a (broadcast) is data from top register the CB shift register array in the last clock. - PowerPoint PPT Presentation
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PATH0 PATH1 PATH2 PATH3 PATH4 16PE
Clock=-17
MUX
SW0
SW1
SW2
SW3
SW4 CB
MUXx select one SW data from five PATH registers
PEx do the calculation ∑|a-b|, b is the data selected by MUXx in the last clock, a (broadcast) is data from top register the CB shift register array in the last clock
MODE B
PATH0 PATH1 PATH2 PATH3 PATH4 16PE
Clock=-16
MUX
b(0,0)
b(8,0)
b(16,0) a(0,0)
SW0
SW1
SW2
SW3
SW4 CB
MODE B
PATH0 PATH1 PATH2 PATH3 PATH4 16PE
Clock=-15
MUX
SW0
SW1
SW2
SW3
SW4 CB
b(1,0)
b(9,0)
b(17,0) a(1,0)
b(0,0)
b(8,0)
b(16,0) a(0,0)
MODE B
PATH0 PATH1 PATH2 PATH3 PATH4 16PE
Clock=-14
MUX
SW0
SW1
SW2
SW3
SW4 CB
b(1,0)
b(9,0)
b(17,0) a(1,0)
b(0,0)
b(8,0)
b(16,0) a(0,0)
b(2,0)
b(10,0)
b(18,0) a(2,0)
MODE B
PATH0 PATH1 PATH2 PATH3 PATH4 16PE
Clock=-13
MUX
SW0
SW1
SW2
SW3
SW4 CB
b(1,0)
b(0,0)
b(9,0)
b(17,0) a(1,0)
b(8,0)
b(16,0) a(0,0)
b(2,0)
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b(18,0) a(2,0)
b(3,0)
b(11,0)
b(19,0) a(3,0)
MODE B
PATH0 PATH1 PATH2 PATH3 PATH4 16PE
Clock=-12
MUX
SW0
SW1
SW2
SW3
SW4 CB
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b(17,0) a(1,0)
b(0,0)
b(8,0)
b(16,0) a(0,0)
b(10,0)
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b(18,0) a(2,0)
b(3,0)
b(11,0)
b(19,0)
a(4,0)
a(3,0)
b(4,0)
b(12,0)
b(20,0)
MODE B
PATH0 PATH1 PATH2 PATH3 PATH4 16PE
Clock=-11
MUX
SW0
SW1
SW2
SW3
SW4 CB
b(0,0)
b(8,0)
b(16,0) a(0,0)
b(1,0)
b(9,0)
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b(21,0) a(5,0)
MODE B
PATH0 PATH1 PATH2 PATH3 PATH4 16PE
Clock=-10
MUX
SW0
SW1
SW2
SW3
SW4 CB
b(0,0)
b(8,0)
b(16,0) a(0,0)
b(1,0)
b(9,0)
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b(14,0)
b(22,0) a(6,0)
MODE B
PATH0 PATH1 PATH2 PATH3 PATH4 16PE
Clock=-9
MUX
SW0
SW1
SW2
SW3
SW4 CB
b(0,0)
b(4,0)
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b(21,0) a(5,0)
b(22,0) a(6,0)
b(23,0) a(7,0)
MODE B
PATH0 PATH1 PATH2 PATH3 PATH4 16PE
Clock=-8
MUX
SW0
SW1
SW2
SW3
SW4 CB
b(0,0)
b(4,0)
b(8,0)
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b(7,0)
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b(23,0) a(7,0)
b(8,1)
b(16,1) a(8,0)
b(0,1)
MODE B
PATH0 PATH1 PATH2 PATH3 PATH4 16PE
Clock=-7
MUX
SW0
SW1
SW2
SW3
SW4 CB
b(0,0)
b(4,0)
b(8,0)
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b(3,0)
b(7,0)
b(11,0)
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b(19,0) a(3,0)
b(20,0) a(4,0)
b(21,0) a(5,0)
b(22,0) a(6,0)
b(23,0) a(7,0)
b(0,1)
b(8,1)
b(16,1) a(8,0)
b(1,1)
b(9,1)
b(17,1) a(9,0)
MODE B
PATH0 PATH1 PATH2 PATH3 PATH4 16PE
Clock=-6
MUX
SW0
SW1
SW2
SW3
SW4 CB
b(0,0)
b(4,0)
b(8,0)
b(12,0)
b(16,0) a(0,0)
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b(8,1)
b(16,1) a(8,0)
b(1,1)
b(9,1)
b(17,1) a(9,0)
b(2,1)
b(10,1)
b(18,1) a(10,0)
MODE B
PATH0 PATH1 PATH2 PATH3 PATH4 16PE
Clock=-5
MUX
SW0
SW1
SW2
SW3
SW4 CB
b(0,0)
b(4,0)
b(8,0)
b(12,0)
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b(23,0) a(7,0)
b(0,1)
b(8,1)
b(16,1) a(8,0)
b(1,1)
b(9,1)
b(17,1) a(9,0)
b(2,1)
b(10,1)
b(18,1) a(10,0)
b(3,1)
b(11,1)
b(19,1) a(11,0)
MODE B
PATH0 PATH1 PATH2 PATH3 PATH4 16PE
Clock=-4
MUX
SW0
SW1
SW2
SW3
SW4 CB
b(0,0)
b(4,0)
b(8,0)
b(12,0)
b(16,0) a(0,0)
b(1,0)
b(5,0)
b(9,0)
b(13,0)
b(17,0) a(1,0)
b(2,0)
b(6,0)
b(10,0)
b(14,0)
b(18,0) a(2,0)
b(3,0)
b(7,0)
b(11,0)
b(15,0)
b(19,0) a(3,0)
b(20,0) a(4,0)
b(21,0) a(5,0)
b(22,0) a(6,0)
b(23,0) a(7,0)
b(0,1)
b(8,1)
b(16,1) a(8,0)
b(1,1)
b(9,1)
b(17,1) a(9,0)
b(2,1)
b(10,1)
b(18,1) a(10,0)
b(3,1)
b(11,1)
b(19,1) a(11,0)
b(4,1)
b(12,1)
b(20,1) a(12,0)
MODE B
PATH0 PATH1 PATH2 PATH3 PATH4 16PE
Clock=-3
MUX
SW0
SW1
SW2
SW3
SW4 CB
b(0,0)
b(4,0)
b(8,0)
b(12,0)
b(16,0) a(0,0)
b(1,0)
b(5,0)
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b(23,0) a(7,0)
b(0,1)
b(8,1)
b(16,1) a(8,0)
b(1,1)
b(9,1)
b(17,1) a(9,0)
b(2,1)
b(10,1)
b(18,1) a(10,0)
b(3,1)
b(11,1)
b(19,1) a(11,0)
b(4,1)
b(20,1) a(12,0)
b(5,1)
b(21,1) a(13,0)
MODE B
PATH0 PATH1 PATH2 PATH3 PATH4 16PE
Clock=-2
MUX
SW0
SW1
SW2
SW3
SW4 CB
b(0,0)
b(4,0)
b(8,0)
b(12,0)
b(16,0) a(0,0)
b(1,0)
b(5,0)
b(9,0)
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b(0,1)
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b(9,1)
b(17,1) a(9,0)
b(2,1)
b(10,1)
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b(3,1)
b(11,1)
b(19,1) a(11,0)
b(20,1) a(12,0)
b(21,1) a(13,0)
b(22,1) a(14,0)
MODE B
PATH0 PATH1 PATH2 PATH3 PATH4 16PE
Clock=-1
MUX
SW0
SW1
SW2
SW3
SW4 CB
b(0,0)
b(4,0)
b(8,0)
b(12,0)
b(16,0) a(0,0)
b(1,0)
b(5,0)
b(9,0)
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b(9,1)
b(17,1) a(9,0)
b(2,1)
b(10,1)
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b(3,1)
b(11,1)
b(19,1) a(11,0)
b(20,1) a(12,0)
b(21,1) a(13,0)
b(22,1) a(14,0)
b(23,1) a(15,0)
SW data in PATH registers with red circle( ) is selected by MUXx
b(0,0)
b(4,0)
b(1,0)
b(5,0)
b(2,0)
b(6,0)
b(3,0)
b(7,0)
b(4,1)
b(5,1)
b(6,1)
b(7,1)
b(0,1)
b(1,1)
b(2,1)
b(3,1)
MODE B
PATH0 PATH1 PATH2 PATH3 PATH4 16PE
Clock=0
MUX
SW0
SW1
SW2
SW3
SW4 CB
b(4,0)
b(8,0)
b(12,0)
b(16,0)
b(1,0)
b(5,0)
b(9,0)
b(13,0)
b(17,0) a(1,0)
b(2,0)
b(6,0)
b(10,0)
b(14,0)
b(18,0) a(2,0)
b(3,0)
b(7,0)
b(11,0)
b(15,0)
b(19,0) a(3,0)
b(4,1)
b(20,0) a(4,0)
b(5,1)
b(21,0) a(5,0)
b(6,1)
b(22,0) a(6,0)
b(7,1)
b(23,0) a(7,0)
b(0,1)
b(8,1)
b(16,1) a(8,0)
b(1,1)
b(9,1)
b(17,1) a(9,0)
b(2,1)
b(10,1)
b(18,1) a(10,0)
b(3,1)
b(11,1)
b(19,1) a(11,0)
b(12,1)
b(20,1) a(12,0)
b(13,1)
b(21,1) a(13,0)
b(14,1)
b(22,1) a(14,0)
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b(23,1) a(15,0)
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b(8,1)
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b(4,0)
b(1,0)
b(5,0)
b(2,0)
b(6,0)
b(3,0)
b(7,0)
b(4,1)
b(5,1)
b(6,1)
b(7,1)
b(1,1)
b(2,1)
b(3,1)
b(8,0)
b(8,1)
MODE B
PATH0 PATH1 PATH2 PATH3 PATH4 16PE
Clock=1
MUX
SW0
SW1
SW2
SW3
SW4 CB
b(4,0)
b(8,0)
b(12,0)
b(16,0)
b(5,0)
b(9,0)
b(13,0)
b(17,0)
b(2,0)
b(6,0)
b(10,0)
b(14,0)
b(18,0) a(2,0)
b(3,0)
b(7,0)
b(11,0)
b(15,0)
b(19,0) a(3,0)
b(4,1)
b(20,0) a(4,0)
b(5,1)
b(21,0) a(5,0)
b(6,1)
b(22,0) a(6,0)
b(7,1)
b(23,0) a(7,0)
b(0,1)
b(8,1)
b(16,1) a(8,0)
b(1,1)
b(9,1)
b(17,1) a(9,0)
b(2,1)
b(10,1)
b(18,1) a(10,0)
b(3,1)
b(11,1)
b(19,1) a(11,0)
b(12,1)
b(20,1) a(12,0)
b(13,1)
b(21,1) a(13,0)
b(14,1)
b(22,1) a(14,0)
b(15,1)
b(23,1) a(15,0)
+|a(1,0)-b(1,0)|
+|a(1,0)-b(2,0)|
+|a(1,0)-b(3,0)|
+|a(1,0)-b(4,0)|
+|a(1,0)-b(5,0)|
+|a(1,0)-b(6,0)|
+|a(1,0)-b(7,0)|
+|a(1,0)-b(1,1)|
+|a(1,0)-b(2,1)|
+|a(1,0)-b(3,1)|
+|a(1,0)-b(4,1)|
+|a(1,0)-b(5,1)|
+|a(1,0)-b(6,1)|
+|a(1,0)-b(7,1)|b(0,1)
b(8,1)
b(16,1) a(0,1)
b(1,1)
b(9,1)
b(17,1) a(1,1)
b(4,0)
b(5,0)
b(2,0)
b(6,0)
b(3,0)
b(7,0)
b(4,1)
b(5,1)
b(6,1)
b(7,1)
b(2,1)
b(3,1)
b(8,0)
b(9,0)
b(8,1)
b(9,1)
+|a(1,0)-b(8,0)|
+|a(1,0)-b(8,1)|
MODE B
PATH0 PATH1 PATH2 PATH3 PATH4 16PE
Clock=2
MUX
SW0
SW1
SW2
SW3
SW4 CB
b(4,0)
b(8,0)
b(12,0)
b(16,0)
b(5,0)
b(9,0)
b(13,0)
b(17,0)
b(6,0)
b(10,0)
b(14,0)
b(18,0)
b(3,0)
b(7,0)
b(11,0)
b(15,0)
b(19,0) a(3,0)
b(4,1)
b(20,0) a(4,0)
b(5,1)
b(21,0) a(5,0)
b(6,1)
b(22,0) a(6,0)
b(7,1)
b(23,0) a(7,0)
b(0,1)
b(8,1)
b(16,1) a(8,0)
b(1,1)
b(9,1)
b(17,1) a(9,0)
b(2,1)
b(10,1)
b(18,1) a(10,0)
b(3,1)
b(11,1)
b(19,1) a(11,0)
b(12,1)
b(20,1) a(12,0)
b(13,1)
b(21,1) a(13,0)
b(14,1)
b(22,1) a(14,0)
b(15,1)
b(23,1) a(15,0)
+|a(2,0)-b(2,0)|
+|a(2,0)-b(3,0)|
+|a(2,0)-b(4,0)|
+|a(2,0)-b(5,0)|
+|a(2,0)-b(6,0)|
+|a(2,0)-b(7,0)|
+|a(2,0)-b(2,1)|
+|a(2,0)-b(3,1)|
+|a(2,0)-b(4,1)|
+|a(2,0)-b(5,1)|
+|a(2,0)-b(6,1)|
+|a(2,0)-b(7,1)|
+|a(2,0)-b(8,1)|
+|a(2,0)-b(9,1)|
b(0,1)
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MODE B
PATH0 PATH1 PATH2 PATH3 PATH4 16PE
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MUX
SW0
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MODE B
PATH0 PATH1 PATH2 PATH3 PATH4 16PE
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MUX
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MODE B
PATH0 PATH1 PATH2 PATH3 PATH4 16PE
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MUX
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MODE B
PATH0 PATH1 PATH2 PATH3 PATH4 16PE
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MODE B
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MUX
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b(15,1)
b(23,1) a(15,0)
b(0,1)
b(8,1)
b(16,1) a(0,1)
b(1,1)
b(9,1)
b(17,1) a(1,1)
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MODE B
PATH0 PATH1 PATH2 PATH3 PATH4 16PE
Clock=10
MUX
SW0
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b(19,2) a(3,2)
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b(20,2) a(4,2)
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b(21,2) a(5,2)
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MODE B
PATH0 PATH1 PATH2 PATH3 PATH4 16PE
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MUX
SW0
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b(17,2) a(9,1)
b(2,2)
b(10,2)
b(18,2) a(10,1)
b(3,2)
b(11,2)
a(11,1)b(19,2)
b(4,2)
b(12,2)
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b(17,3) a(9,2)
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b(2,3)
b(10,3)
b(18,3) a(10,2)
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b(3,3)
b(11,3)
b(19,3) a(11,2)
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b(4,3)
b(12,3)
b(20,3) a(12,2)
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b(5,3)
b(13,3)
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MODE B
PATH0 PATH1 PATH2 PATH3 PATH4 16PE
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MUX
SW0
SW1
SW2
SW3
SW4 CB
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b(16,2) a(0,2)
b(16,1) +|a(15,1)-b(15,1)|
b(1,2)
b(9,2)
b(17,2) a(1,2)
b(17,1) +|a(15,1)-b(16,1)|
b(2,2)
b(10,2)
b(18,2) a(2,2)
b(18,1) +|a(15,1)-b(17,1)|
b(3,2)
b(11,2)
b(19,2) a(3,2)
b(19,1) +|a(15,1)-b(18,1)|
b(4,2)
b(12,2)
b(20,2) a(4,2)
b(20,1) +|a(15,1)-b(19,1)|
b(5,2)
b(13,2)
b(21,2) a(5,2)
b(21,1) +|a(15,1)-b(20,1)|
b(6,2)
b(14,2)
b(22,2) a(6,2)
b(14,2) +|a(15,1)-b(21,1)|
b(7,2)
b(15,2)
b(23,2) a(7,2)
b(15,2) +|a(15,1)-b(22,1)|
b(0,3)
b(8,3)
b(16,3) a(8,2)
b(16,2) +|a(15,1)-b(15,2)|
b(1,3)
b(9,3)
b(17,3) a(9,2)
b(17,2) +|a(15,1)-b(16,2)|
b(2,3)
b(10,3)
b(18,3) a(10,2)
b(18,2) +|a(15,1)-b(17,2)|
b(3,3)
b(11,3)
b(19,3) a(11,2)
b(19,2) +|a(15,1)-b(18,2)|
b(4,3)
b(12,3)
b(20,3) a(12,2)
b(20,2) +|a(15,1)-b(19,2)|
b(5,3)
b(13,3)
b(21,3) a(13,2)
b(21,2) +|a(15,1)-b(20,2)|
b(6,3)
b(14,3)
b(22,3) a(14,2)
b(22,2) +|a(15,1)-b(21,2)|
b(7,3)
b(15,3)
b(23,3) a(15,2)
b(23,2) +|a(15,1)-b(22,2)|
MODE B
